Fixed SRAM select logic and /RD timing bug in PLD
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fda2598e06
commit
9e6c1915ee
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@ -16,8 +16,8 @@ Pin 23 = /WR S0 = 0 S1 = 1
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Pin 22 = /RD S0 = 0 S1 = 1
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10 ---- ---- ---- ---- ---- ---- ---- ---- ---- ---- ----
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11 x--- x--- ---- ---- ---- ---- ---- ---- ---- ---- ----
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12 xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx
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11 ---- x--- ---- ---- ---- ---- ---- ---- ---- ---- ----
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12 ---- -x-- ---- ---- ---- ---- ---- ---- ---- ---- ----
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13 xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx
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14 xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx
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15 xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx xxxx
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@ -8,7 +8,8 @@ Device: GAL22V10
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*L0044 11111111111111111111111111111111111111111111
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*L0088 01111011111111111111111111111111111111111111
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*L0440 11111111111111111111111111111111111111111111
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*L0484 01110111111111111111111111111111111111111111
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*L0484 11110111111111111111111111111111111111111111
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*L0528 11111011111111111111111111111111111111111111
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*L0924 11111111111111111111111111111111111111111111
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*L0968 11111111101111111111111111111111111111111111
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*L1012 11111111111111111111101110111011011101111111
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@ -22,6 +23,6 @@ Device: GAL22V10
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*L3124 11111111111110111111111111111111111101111111
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*L5808 01010100010100000000
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*L5828 0101001101000101010011100101010001001001010011100100010101001100
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*C53d6
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*C58d0
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*
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b9c8
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c3a2
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@ -6,7 +6,7 @@ NC NC NC NC NC /RAM1 /RAM0 /ROM1 /ROM0 /RD /WR VCC
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WR = PHI2 * /RW
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RD = PHI2 * RW
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RD = RW + /RW
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RAM0 = CS5 * /A19 * /A20 * /A21 * /A22 * /A23
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@ -22,4 +22,4 @@ ROM0 = CS4 +
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DESCRIPTION
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PLD Logic for the Sentinel 65X PLD
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PLD Logic for the Sentinel 65X PLD
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Reference in New Issue